課.程.目.標 |
| 本課程通過大量的實際電路設計，使得學員可以在較短時間內具備電路板設計的全面能力。 |
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培.養.對.象 |
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對電路原理知識有一定了解，有過單片機或相關電路設計經驗的工程師，企業硬件設計部門負責人。 |
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班.級.規.模.及.環.境 |
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為了保證培訓效果，增加互動環節，我們堅持小班授課，每期報名人數限5人，多余人員安排到下一期進行。 |
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.質.量.保.障. |
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1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持，充分保證培訓后出效果；
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教學時間，教學地點 |
上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：深圳大學成教院/ 電影大廈(地鐵一號線大劇院站)【北京分部】：福鑫大樓/北京中山學院 【武漢分部】：佳源大廈（高新二路） 【南京分部】：金港大廈(和燕路)
【成都分部】：領館區1號（中和大道）
最近開課時間(連續班/周末班/晚班）：PCB Layout班開課：2025年10月1日..節假日班火熱報名中.....實戰培訓......直播、現場培訓皆可....用心服務..............--即將開課-----即將開課，請咨詢客服。 |
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學時 |
課時： 一個月
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師資團隊 |
◆【李老師】
8年來一直從事FPGA數字電路設計，高速DSP軟硬件的開發，高速PCB，Layout設計經驗非常豐富。
精通Allegro cadence和candence SPECCTRAQuest等信號完整性仿真，精通高速PCB
SI仿真、Altium Designer以及PADS工具 。成功開發了多個高速DSP和FPGA結合的高難度項目。 ◆【黃老師】
有9年的FPGA和DSP系統硬件開發經驗,5年視頻和圖像處理領域的高速DSP系統硬、軟件和FPGA系統的設計和開發經驗，高速系統設計經驗非常豐富，精通Allegro
cadence和candence SPECCTRAQuest等信號完整性仿真，精通高速PCB SI仿真工具以及PADS,Altium Designer等PCB設計工具。
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課.程.進.度.安.排 |
| .課.程.大.綱. |
第一階段-Allegro(Cadence)電子線路板設計 |
學習使用 ORCAD 軟件進行原理圖的制作，電路圖的零件設計、使用
Allegro 軟件進行 PCBLayout ， PCB 封裝制作、高速布線規則設置、出 gerber 文件、用
CAM350 檢查 gerber 文件。應用范圍：制作高速線路板（如：DSP6000高速板等） .
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第二階段 Allegro Cadence 仿真、信號完整性 |
1 高速PCB設計中的理論基礎
傳輸線理論、信號完整性（反射、串擾、過沖、地彈、振鈴等）、電磁兼容性和時序匹配等等。
2 SPECCTRAQuest設計流程
2.1 Pre-Placement
2.2 Board Setup Requirements
for Extracting and Applying Topologies
2.3 Database Setup Advisor
—Cross-Section
—DC
Nets
—DC
Voltages
—Device
Setup
—SI Models
—SI
Audit
3 拓撲結構的抽取與仿真 Extracting and Simulating Topologies
3.1 Pre-Route Extraction Setup—Default
Model Selection.
3.2 Pre-Route Extraction Setup—Unrouted
Interconnect
3.3 Pre-Route Template Extraction
3.4 SQ Signal Explorer Expert
3.5 Analysis Preferences
3.6 SigWave
3.7 Delay Measurements
4
差分信號設計 Differential Pair Design Exploration
8.1 Types of Differential Pairs
in SPECCTRAQuest
8.2 Create Differential Pair
Using SPECCTRAQuest
8.3 Create Differential Pair
Using Constraint Manager
8.4 Assigning Differential Pair
Signal Models
8.5 Preference to Extract Unrouted
Differential Pair Topology
8.6 Extracting Unrouted Differential
Pair Topology
8.7 Custom Stimulus to Analyze
Differential Pair Topology
8.8 Differential Pair Topology
Analysis
8.9 Coupled Trace Model and
Differential Pair Topology
8.10 Layout Cross-section Editor
8.11 Differential Pair Constraints
8.12 Differential Pair Constraints
in the Constraint Manager
8.13 Differential Pair Analysis
in the Constraint Manager
8.14 Post Route Extraction
5 時序仿真和和PI仿真
5.1 時序仿真
5.2 PI仿真 |
第三階段-Allegro Cadence DSP6000高速板設計實戰 |
DSP6000高速板設計主要內容有:
1.DSP6000高速板功能方框圖培訓。
2.元件庫建立管理
3.電腦原理圖設計
4.電腦PCB疊層結構、阻抗控制介紹
5.電腦PCB布局以及布線設計
6.出Gerber文件
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