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上課地點：【上�！浚和瑵髮W(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：深圳大學成教院/ 電影大廈(地鐵一號線大劇院站)【北京分部】：福鑫大樓/北京中山學院【武漢分部】：佳源大廈（高新二路）【南京分部】：金港大廈(和燕路) 【成都分部】：領館區1號（中和大道）
最近開課時間(連續班/周末班/晚班）：ISE 設計入門：2025年7月14日..用心服務..............--即將開課----即將開課，請咨詢客服。

學時

　    ◆課時：共6天,36學時

        ◆外地學員：代理安排食宿（需提前預定）
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        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后,培訓老師留給學員手機和Email,免費提供半年的技術支持，充分保證培訓后出效果；
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　　ISE 設計入門

課程介紹

通過本課程您將了解項目結構、進程窗口、各種 ISE? 軟件設計流程和 Xilinx 綜合技術(XST) 方面的信息。您還能檢驗 XST 綜合，并使用項目瀏覽器 (Project Navigator) GUI 中的XST 約束文件。您還將了解工程采集系統 (Engineering Capture System, ECS)，StateCAD 和ISE 仿真器工具方面的信息。

必備條件

?? 具備 VHDL 或 Verilog 語言的基礎知識
?? 具備 Virtex™ FPGA 架構的基礎知識

課程概要

        ?? 在 ISE 軟件中創建新的項目瀏覽器項目
        ?? 列出 ISE 軟件內可使用的設計流程
        ?? 訪問和修改 XST 綜合選項
        ?? 利用工程采集系統 (Engineering Capture System, ESC) 原理圖輸入工具創建原理圖設計
        ?? 利用 StateCAD 工具創建符號化狀態機
        ?? 創建測試平臺并利用 ISE 仿真器對設計進行仿真

實驗介紹

        實驗 1 項目瀏覽器獲得在 ISE 軟件中進行 HDL 流程操作的全面的動手經驗。創建新項目、添
                      加源文件、綜合設計以及利用誤差導航特性。
        實驗 2 綜合選項修改 XST 綜合特性，閱讀綜合報告來比較綜合結果，并利用快照(snapshot)
                      功能。
        實驗 3 ECS 執行原理圖編輯器的基本任務，如添加符號、連接符號和線路、給線路和總線命
                      名、添加 I/O 標記和使用帶有 ECS 的 Xilinx CORE Generator? 軟件系統。
        實驗 4 ISE 仿真器和 StateCAD 工具
                      對設計周期流程進行仿真和驗證。演示如何將這些工具整合到 ISE 軟件

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